如何為嵌入式系統選擇最低功耗的微控制器
待機（休眠）電流
實現最大能效（和電池壽命）轉化為確保每個MCU任務在盡可能短的時間內以最小可能電壓消耗最小可能電流，以便器件將大部分時間用于非常低功耗的睡眠模式。在一些應用中，睡眠模式電流是對整體能量消耗負有最大責任的參數。然而，經常被忽視的是MCU可實現的絕對最小睡眠電流主要受其漏電流的限制。例如，輸入泄漏電流規格為100 nA的20輸入設備在睡眠模式下可能消耗高達2μA的功率。
泄漏電流受多種因素的影響，但最重要的因素是使用的基礎流程技術。在某些情況下，供應商會選擇使用0.25或0.35微米工藝技術來降低由泄漏引起的睡眠電流，但這種選擇是以更高的有功電流為代價的。在其他情況下，MCU供應商選擇使用0.18微米或更小的工藝技術來降低有源模式電流，但這是以更高漏電流為代價的。圍繞這一難題的獨特解決方案是應用混合信號專業知識來實施先進的電源管理單元（PMU），專門用于限制泄漏并實現超低睡眠電流，無論使用何種基礎工藝技術。使用0.25微米或更小的工藝技術，最小化睡眠模式電流需要削減數字核心的功率。在睡眠模式下工作的模塊，如電源管理電路，I/O焊盤單元和RTC，必須使用未調節的電源工作，以避免在LDO中燒毀額外的電流。切斷數字核心邏輯的電源也可以防止其斷態泄漏對睡眠模式電流產生影響;但是，MCU必須在休眠模式下保留RAM內容和所有寄存器的狀態，以便代碼執行可以從中斷處繼續。這種保存可以通過一些非常低電流，睡眠模式，鎖存偏置方案或通過使用特殊的保持鎖存器來執行，該保持鎖存器可以將狀態保持在睡眠模式而沒有顯著的泄漏。 MCU還需要某種形式的連續電源電壓監控（即“掉電檢測”），以便在電源電壓低于最小保持電壓的情況下復位器件，這可能會破壞狀態。
從系統設計人員的角度來看因此，重要的是要檢查潛在的漏電流規范，以確定哪些MCU供應商已經應用其混合信號專業知識來解決這一復雜問題。設計人員還應該考慮大多數供應商提供許多不同的待機電流選項的事實。大多數供應商將突出顯示其絕對最低睡眠模式電流，這通常對應于實時時鐘消耗的電流和禁用掉電檢測器。一些供應商會更進一步，并引用關閉模式電流，該電流不會保留存儲器并需要復位才能喚醒，這通常不是一個非常實用的模式。因此，由于大多數應用程序都需要完整的RAM和寄存器保留，因此系統設計人員必須根據以下指標進行并排比較：
待機/睡眠模式電流與實時時鐘和掉電禁用（具有RAM保持）
待機/睡眠模式電流，實時時鐘禁用和掉電啟用
待機/睡眠模式電流與實時時鐘然后，系統設計人員可以根據應用程序的占空比計算總體待機模式功率預算時使用正確的值。
喚醒能量
如前所述，在使用睡眠模式的系統中，可能會浪費大量功率來喚醒MCU并準備采集或處理數據。實際上，在某些應用中，MCU在退出待機狀態時通常會使用與設備完全處理數據時一樣多的能量。因此，設計一個MCU以在極短的時間內喚醒和穩定非常重要，以便最大限度地減少在能量浪費狀態下花費的時間。
MCU應該能夠退出睡眠模式來自外部觸發事件或內部計時器。最靈活的周期性喚醒源是一個實時時鐘，能夠從外部晶體振蕩器（用于需要精確定時的應用）或低頻內部振蕩器運行，無需在低精度應用中使用晶體。避免使用慢啟動晶體振蕩器作為高速系統時鐘;一個準確的，快速啟動的片上振蕩器是更好的選擇。
此外，由于許多產品定期喚醒以使用片上ADC對輸入進行采樣，因此為數字電路提供足夠的時間非常重要喚醒和模擬電路穩定開始進行有效測量。模擬模塊的啟動行為會對在活動模式下花費的時間量產生重大影響;使用外部去耦電容的穩壓器或基準電壓源可能需要幾毫秒才能穩定下來。有時，MCU供應商只會引用數字電路的喚醒時間，而忽略了模擬電路穩定所需的時間。因此，系統設計人員必須分析數字和模擬電路的整體喚醒和建立時間，以分析這種浪費能源的真實成本。
其他注意事項
當然還有其他注意事項進一步降低系統功耗的方法。例如，通常使用2 x AA/AAA電池配置，因為MCU通常通常可以在低至1.8 V的電壓下運行，有時只能降低功能（無ADC;降低指令時鐘速度）。降低功耗（和環境影響）的創新方法是將設計轉換為單個電池配置，其中電池可以一直運行直至其使用壽命（0.9 V）。為實現這一目標，MCU必須集成高度優化的DC-DC轉換器，該轉換器可以在電池的最低可用電壓下工作，在堿性化學情況下為0.9 V.這種方法還可以節省供應商和/或降低功耗的另一種方法是使用高度集成的MCU，包括ADC，DAC和其他外設，因為MCU可以根據應用的需要控制啟用和禁用這些外設。例如，某些MCU提供具有突發模式的專用低功耗ADC，可在CPU關閉時進行模擬測量，以進一步降低功耗。
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